AI与高性能蓄意（HPC）将成为阛阓最大主力，占据55%的阛阓份额。

台积电资深副总司理兼副首席运营长张晓强在年度时候论坛上示意，AI 将是东谈主类历史上最具影响力的科技，预估到 2030 年，寰球半导体产值将达 1.5 万亿好意思元，宣告由 AI 驱动的半导体新纪元已正经到来。

2030 年产值有望达 1.5 万亿好意思元

张晓强示意，从生成式 AI 到交互式 AI，东谈主工智能的发展速率已远超行业预期。AI 的普及造成了矫健的飞轮效应，从模子实验到结尾推理，算力晋升带动分娩力与价值创造，进而诱骗更多资金参加、催生更大算力需求，鼓舞半导体需求迎来爆发式增长。

受益于这一趋势，预测 2026 年寰球半导体产值将打破 1 万亿好意思元，到 2030 年举座阛阓边界更将攀升至 1.5 万亿好意思元。届时，AI 与高性能蓄意（HPC）将成为阛阓最大主力，占据 55% 的阛阓份额；智高手机孝顺约 20%，汽车电子与物联网各占约 10%。张晓强还提到，晶圆代工模式将芯片联想与制造拆分，大幅加速了产业创新，当今市面上的 AI 加速器委果一谈依托这一营业模式发展。

打破运算瓶颈：3DIC 内存堆叠与硅光时候

硬件架构层面，现时 AI 系统高度依赖先进逻辑芯片与高带宽内存（HBM）的整合。为知足畴前 AI 推理对低延迟、高带宽数据读取的严苛条目，台积电正与内存厂商深度调解，后续将接受 3DIC 时候，把 DRAM 平直堆叠在运算逻辑芯片上方，以此打破内存传输瓶颈。此外，面向多芯片集成的行业趋势，除 3D 堆叠时候外，张晓强注释强调了共封装光学（CPO）时候的进军性，并直言畴前超高速信号传输领域惟一光学时候可行。

AI向边际蓄意渗入，芯片行业迎来模式剧变

张晓强指出，AI 的巨大影响力正快速延迟至结尾边际建树。在智高手机与通讯领域，2026 年旗舰手机已启动接受台积电 3 纳米工艺。同期，为适配畴前 6G 通讯十倍级的数据传输速率增长，射频（RF）贯串时候已进入台积电 6 纳米工艺期间，相机图像信号惩处器（ISP）的时候架构也在向能效更高的工艺迭代。

在智能眼镜领域，张晓强颠倒看好其发展后劲，合计智能眼镜是贯串东谈主脑与云霄超算中心最有用的载体。跟着台积电将高压清楚时候落地先进工艺、大幅责怪功耗，畴前铺张者有望以亲民价钱，买到精辟且体验出色的智能眼镜家具。

车用领域方面，张晓强示意，当代汽车早已不仅仅机械家具，更贴切的定位是软件界说的电子家具。为兑现 L5 级自动驾驶所需的强大算力，畴前车载蓄意芯片将从当下的 5 纳米快速向 3 纳米乃至 2 纳米工艺演进，微收尾器（MCU）也正朝着 16/12 纳米工艺升级。

临了在东谈主形机器东谈主领域，这类家具买通虚构与物理天下，需要矫健的逻辑运算中枢以及海量传感器集成，行业模式如同 20 年前的 PC 阛阓，将成为半导体产业的下一个增长新蓝海。

张晓强在追忆时强调，欧宝app1.5 万亿好意思元边界的半导体产业，还将带动数倍体量的电子信息科技关系阛阓。他示意，中国台湾处在寰球 AI 翻新的中枢节点，领有寰球最完善的产业生态，台积电对此充满信心，将合手续联袂广达等客户及行业调解伙伴，共同打造 AI 产业期间的全新高度。

台积电SoIC 3D 封装蓝图

跟着 AI 与高性能运算（HPC）对芯片性能的条目日益严苛，先进封装时候已成为驱动性能升级的中枢关节。台积电在 2026 年北好意思时候论坛上公布了最新 SoIC 3D 封装时候阶梯图，晓谕将于 2029 年进一步削弱互联间距，并推出 A14 对 A14 的 SoIC 堆叠时候，彰显其在先进封装领域的强盛布局贪心。

说明台积电最新公布的时候阶梯图，SoIC 的互联间距将从当今的 6 微米（μm），在 2029 年大幅削弱至 4.5 微米。这项间距微缩时候对羼杂键合芯片堆叠至关进军，平直决定了芯片之间可容纳的垂直互联数目。台积电示意，预测 2029 年量产的 A14 对 A14 SoIC 时候，芯片间 I/O 密度将比 N2 对 N2 的 SoIC 晋升 1.8 倍。

SoIC 隶属于台积电 3DFabric 先进封装时候体系，旨在通过超高密度垂直堆叠时候削弱芯片体积、晋升举座性能，同期责怪电阻、电感与电容参数。本次时候阶梯图的中枢变革，是从传统的濒临背（face-to-back）堆叠转向濒临面（face-to-face）堆叠。濒临背架构下，信号需要经由更为复杂的传输旅途，包含底层芯片的硅通孔；而接受濒临面堆叠时，两颗芯片的有源金属层可平直对皆，通过羼杂铜键合工艺兑现互联，大幅镌汰芯片间传输旅途。

据博通（Broadcom）实测数据清楚，濒临面堆叠的信号密度可达时时每毫米 14000 个信号，远超濒临背堆叠的 1500 个信号。时候打破带来了更高带宽与更低延迟，不外行业仍需合手续攻克随之而来的制造工艺与散热抵制。当今台积电高密度芯片堆叠时候已进入落地行使阶段，富士通（Fujitsu）专为 AI 与 HPC 负载联想的 Monaka 惩处器，有望成为首批受益于濒临面芯片堆叠时候的家具之一。

此外，博通在 2026 年 2 月晓谕，已正经出货会通 2.5D 集成与 3D-IC 濒临面堆叠时候的 3.5D XDSiP 平台，并基于该平台打造 2 纳米定制蓄意 SoC，供给 Monaka 模式使用，兑现蓄意、内存与会聚 I/O 在紧凑型封装内零丁膨胀。这款惩处器预测 2027 年正经推出，届时将考据高密度濒临面堆叠时候是否具备营业化量产的经济价值。

这份 SoIC 时候阶梯图，契合了寰球半导体产业的发展趋势。跟着先进制程工艺微缩资本攀升、时候难度加大，晶圆代工场与芯片联想企业正将性能晋升的重点转向先进封装领域，涵盖更大尺寸中介层、更高密度芯片互联、堆叠缓存以及 HBM 集成等标的。受资本、良率、散热不休和联想复杂度等要素影响，台积电 2029 年的时候成见，并不虞味着扫数高端惩处器都会全面接受最高规格的 SoIC 有策动。但这份阶梯图明晰标明，台积电已将垂直堆叠整合视为先进制程策略的中枢复古，而非局限于小众细分的封装时候遴荐。

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